職位描述
VerilogPythonMATLABVHDL通信/網(wǎng)絡(luò)設(shè)備
崗位職責(zé)：
1、負(fù)責(zé)信號處理算法需求分析、完成導(dǎo)航、通信或雷達(dá)相關(guān)的信號處理算法方案設(shè)計與仿真；
2、負(fù)責(zé)在FPGA上實現(xiàn)陣列抗干擾信號處理算法，負(fù)責(zé)代碼編寫、調(diào)試及維護(hù)；
3、負(fù)責(zé)技術(shù)或產(chǎn)品開發(fā)各個階段相關(guān)的技術(shù)評審和技術(shù)文件編寫；
4、解決研制、生產(chǎn)過程中出現(xiàn)的算法問題。
任職要求：
1、熟練掌握Matlab或Python進(jìn)行仿真；
2、熟悉Verilog/VHDL語言；
3、具有FPGA嵌入式系統(tǒng)相關(guān)項目經(jīng)驗優(yōu)先；
4、具有陣列抗干擾、自適應(yīng)信號處理、衛(wèi)星導(dǎo)航、通信或雷達(dá)信號處理算法相關(guān)經(jīng)驗優(yōu)先；
5、具有較強(qiáng)的溝通表達(dá)能力。
工作地點
成都郫都區(qū)天奧科技產(chǎn)業(yè)園
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