職位描述
Verilog HDL
崗位職責：
1. 根據項目的功能需求及任務安排，編寫邏輯方案設計、模塊劃分；
2. 功能實現的詳細代碼，仿真實現，測試用例，邏輯使用說明文檔的編寫；
3. 協助硬件工程師確定器件選型、對FPGA等芯片的設計進行討論指導、審查；
4. 項目聯調，配合軟件、硬件工程師進行各個接口的調試，以及與客戶的聯調。
崗位要求
1. 碩士及以上學歷，碩士及以上學歷，計算機類、電子信息類、電氣類、控制類、自動化類、儀器儀表等相關專業；
2.熟悉Verilog/VHDL語言；熟悉FPGA的高速接口開發，包括PCIe、DDR、ADC、DAC、GTX、SRIO等優先；
4.具有良好的學習能力、溝通能力、文檔書寫能力及上進心和自律性。
工作地點
北京豐臺區中國中鐵建工集團西配樓三層
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職位發布者
何鮮利/招聘經理
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航天新長征大道科技有限公司北京分公司航天新長征大道科技有限公司是中國航天科技集團中國運載火箭技術研究院旗下高新技術企業。航天大道公司秉承“聚焦數據與智能技術，持續為客戶創造價值”發展使命，致力于為客戶提供以長征云工業互聯網為核心的先進、自主、可靠的智能制造與裝備保障系統解決方案、產品和服務，助推航天智能制造轉型升級、助推中國智能制造轉型升級。航天大道公司已獲評國家級高新技術企業、國家級重點專精特新“小巨人”企業、國資委“科改示范”企業、國家雙跨工業互聯網平臺、北京2022年冬奧會和冬殘奧會開閉幕式核心系統供應商等諸多榮譽。公司在北京、大連設立研發中心，大連、濟南、西安、成都設立區域服務中心，技術研發團隊占總人數的75%，985/211院校碩士、博士占比60%以上。公司員工整體年齡結構年輕化，平均年齡30歲，能力和學歷層次呈現較好的梯隊結構，是一支創新能力較強的高科技年輕隊伍。
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