職位描述
模塊級驗證子系統級驗證系統級驗證芯片級驗證C語言VCS以太網電子/半導體/集成電路
崗位職責：
- 參與數字IC設計研發或驗證流程
- 負責使用Verilog或System Verilog進行硬件描述和建模
- 參與有關數字IC或FPGA的科研項目或競賽
崗位要求：
1. 2025年應屆生，二本以上，電子信息，集成電路相關專業
2. 熟悉Verilog或System Verilog，熟悉腳本語言：C或Python
3. 在校期間參與過數字IC或FPGA的科研項目或競賽，或者有相關實習經驗
4. 熟悉數字IC設計研發或驗證流程
工作地點
北京海淀區(在建)昌平線南延線;13號線
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職位發布者
謝靜/招聘專員
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