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1. CPLD/FPGA開發設計： - 負責CPLD/FPGA的硬件邏輯設計、代碼開發（Verilog/VHDL）及優化，實現產品功能需求。 - 完成模塊級和系統級的仿真驗證（ModelSim、VCS等工具），確保時序收斂和功能正確性。 - 配合硬件團隊完成電路設計，解決信號完整性、功耗及時序問題。 2. 系統集成與調試： - 熟悉INTEL AMD等主流服務器平臺硬件設計及時序控制邏輯，熟悉主板 背板等板卡代碼框架。 - 熟悉CPLD與MCU、傳感器、通信接口（如I2C、SPI、UART）的協同開發。 - 分析并解決開發過程中出現的邏輯功能異常問題。 3. 文檔與協作： - 編寫設計文檔、測試報告及用戶手冊，確保項目可追溯性。 - 協助測試團隊制定驗證方案，支持量產化過程中的問題排查。 --- 任職資格 1. 基本要求： - 本科及以上學歷，電子工程、微電子、通信等相關專業。 - 2年以上CPLD/FPGA開發經驗，熟悉安路、Xilinx、Altera（Intel）或Lattice等主流廠商器件。 - 精通硬件描述語言（Verilog/VHDL），掌握狀態機設計、時序約束及跨時鐘域處理。 2. 技能工具： - 熟練使用EDA工具鏈（TD、Quartus、Diamond、Vivado、ISE等）及仿真調試工具。 - 熟悉常用通信協議（如I2C、SPI）及接口設計，具備硬件調試能力（示波器、邏輯分析儀）。 - 了解低功耗設計方法及靜態時序分析（STA）。