職位描述
FPGAVERILOG/VHDL
崗位職責：
1. 負責高階調制相關的嵌入式軟件設計工作
2. 使用Vivado進行FPGA開發與調試
3. 運用Matlab進行算法開發、模型搭建、數據分析與仿真
4. 在嵌入式平臺上實現高階調制解調算法
5. 深入理解并應用數字信號處理理論及常用算法
崗位要求：
1. 碩士以上學歷，電子信息工程、通信工程專業
2. 三年以上嵌入式軟件設計工作經驗
3. 精通Vivado和Matlab
4. 深入理解數字信號處理理論
5. 熟悉常用數字信號處理算法
工作地點
鹿泉區石家莊信息產業園E1樓
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