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更新于 6月11日

FPGA工程師(五險一金+周末雙休)

8000-13000元·13薪

職位描述

Verilog HDLVHDL計算機軟件電子/半導體/集成電路電子設備制造
崗位職責: 1.根據部門的相關制度及流程,確認產品的大邏輯需求; 2.負責邏輯設計、大邏輯測試及產品聯試工作; 3.負責技術支持工作
職位要求: 1、熟練掌握VerilogVHDL語言,具有較為復雜的邏輯設計經驗,優良的RTL代碼風格; 2、熟悉XILINX設計流程,能熟練使用大規模邏輯設計相關開發工具(如綜合工具、仿真工具等); 3、熟悉常用uart,iic,rs485,rs422 大數量、多通道的數據吞吐,及數據通道路由交換; 4、具備模塊/整機的控制系統調試測試經驗優先,工作涉及系統聯調,參與故障分析;

獎金績效

雙休,餐補、加班費,生日禮金等

工作地點

中國電子科技集團公司第五十四研究所石家莊市橋西區中山西路589號

職位發布者

蔡女士/人事經理

三日內活躍
立即溝通
公司Logo成都秀為科技發展有限公司
成都秀為科技發展有限公司,成立于2006年,是一家面向電子信息領域,從事通信相關產品研發的高新技術企業。公司秉承真誠、實干、創新、卓越理念,多年來深耕于信號采集處理領域,為全國的客戶提供模塊到整機的解決方案。目前,公司已入選成都市科技型中小企業名錄。目前公司員工中研發人員占比75%,重點大學本科學歷占比80%,碩士以上學歷占比超過30%。公司可根據客戶的需求提供定制化服務和產品,業務范圍涵蓋研發設計、外協生產、組裝、銷售等環節。同時,公司也在逐步推出型號產品,以實現定型化產品的量產。公司主要產品集中于信號采集、通用信號處理、存儲與回放等業務方位,形成了系列的X86采集回放設備平臺產品,嵌入式采集存儲設備,便攜式測向設備;高中低端的信道化通用偵收設備,以及小型化便攜式頻譜傳感器產品,小型化通用解調器等系列產品。其中,超寬帶接收機單臺設備,已實現單張合同簽約額520萬元。秀為科技自成立以來,堅持以數字信號處理為本的技術發展路線,深挖數字信號處理技術,尤其是配套軟件系統的開發和應用。自2014年3月開始,公司根據SDR(軟件無線電)相關的開源項目,從原理圖到算法以及實現,投入了一定的人力跟蹤學習,目前已在手持式頻譜傳感器,頻譜監測設備等產品中,得到了有效的應用,獲得了客戶的認可與好評。公司的戰略規劃是:堅守數字信號處理專業領域,重點發展頻譜監測傳感器、各類數字信號接收機,以及采集回放產品,并逐步形成成熟的軟件平臺產品。公司預計2020年實現營收3000萬元,2021年目標實現營收翻一番。公司業務方向:面向軍工領域,針對通信和雷達方向,提供高可靠的信號處理方案與產品公司當前主要客戶為各個軍工單位,如中xx所,總參x所,雷科防務集團公司等。公司產品以定制模塊和標準產品為主,涵蓋通用信號處理平臺,數字信道化接收機和高速采集回放系統等,公司自成立開始,在信號處理域不輟深耕,形成了一系列的產品和軟件知識產權,得到了用戶的肯定公司產品介紹應用方向:高速采集,信號處理,采集回放,監測測向產品類別:定制化模塊,標準模塊,成熟產品
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