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崗位職責(zé)： 1. 負(fù)責(zé)CMOS圖像傳感器及相關(guān)模擬/數(shù)模混合芯片的模擬電路模塊設(shè)計(jì)與驗(yàn)證，涵蓋 AD/DA、PGA、Bandgap、LDO、Op-Amp、PLL、LVDS、I/O 等核心模塊； 2. 根據(jù)系統(tǒng)需求制定模塊規(guī)格，進(jìn)行可行性分析、電路仿真與性能評(píng)估，輸出詳細(xì)設(shè)計(jì)文檔； 3. 完成電路布局與后仿，確保設(shè)計(jì)滿足工藝、電氣與面積等要求； 4. 參與芯片頂層設(shè)計(jì)與模塊集成，支持從設(shè)計(jì)到流片、封裝、驗(yàn)證、量產(chǎn)的完整流程； 5. 根據(jù)項(xiàng)目需要承擔(dān)進(jìn)度管理、團(tuán)隊(duì)協(xié)作與知識(shí)產(chǎn)權(quán)產(chǎn)出等工作，推動(dòng)技術(shù)積累和創(chuàng)新。 任職要求： 1. 本科及以上學(xué)歷，微電子學(xué)、電子工程、集成電路、通信等相關(guān)專業(yè)； 2. 具備2年及以上模擬電路設(shè)計(jì)經(jīng)驗(yàn)優(yōu)先，熟悉Analog IC設(shè)計(jì)流程，熟練掌握Cadence Virtuoso/Spectre、HSPICE等EDA工具； 3. 熟悉主流模擬電路模塊（AD/DA、PGA、Bandgap、LDO、Op-Amp、PLL等）的設(shè)計(jì)、仿真、優(yōu)化與驗(yàn)證流程； 4. 有CMOS圖像傳感器相關(guān)設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先，熟悉圖像傳感器模擬電路架構(gòu)、頂層設(shè)計(jì)或像素陣列集成優(yōu)先考慮； 5. 具備數(shù)模混合芯片、大規(guī)模集成電路設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先； 6. 具備較強(qiáng)的學(xué)習(xí)能力、問題分析能力及良好的溝通能力，責(zé)任心強(qiáng)，能夠獨(dú)立承擔(dān)模塊開發(fā)任務(wù)并積極協(xié)作團(tuán)隊(duì)工作。 職位福利：（享有期權(quán)激勵(lì)，核心人才可直接授予股權(quán)/五險(xiǎn)一金/年底獎(jiǎng)勵(lì)3月薪水/周末雙休/飯補(bǔ)/杭州市人才補(bǔ)貼政策等）